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我想要verilog 的output兩個時脈間的值做比較

verilog

neooen891126 2021-08-22 20:38:34 ‧ 697 瀏覽

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大家好，我想要讓con的輸出訊號做比大小該怎麼做呢?
兩個兩個輸出相比如476和717比，1014和1059比等等，保留大的

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