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Day 18

2022-10-01

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超簡單的 Verilog 入門講解系列

[Day 18] Verilog E-1 難度丁 P2海域的解謎3 - Rs232訊號協議(匯出圖形1)

我們來匯出圖形吧題目: Rs232的訊號，鮑率我們就設定 115200 ，clk速度 24MHz 老樣子設計上幾個重點: 有一個 Reg 主要是 RS232...

北上提督 (RobinHsieh)

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Day 16

2022-09-27

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闖進Python異世界系列

[Day 16] 闖進Python異世界 - Singly Linked List 2/3

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Day 28

2022-10-13

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如果可以，我想用30天的時間打造一間抵霸閣系列

[Day28]抵霸閣- 初步認識正則表達式

由於常常在回覆表單時會被限制手機欄位只能輸入數字或是在註冊時輸入密碼要求一定要包含大小寫、數字、特殊字元等等若不符合規則就沒辦法進行下一步因此讓我們來了解這些輸...

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Day 19

2022-10-04

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Day 16

2022-09-30

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這篇要來介紹的就是覆寫 overridding，子類別繼承父類別後，如果不滿意父類別定義的方法，子類別可以在繼承後重新改寫，這就是覆寫。子類別宣告覆寫時，方法名...

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Day 4

2022-09-19

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寫個好的lib大家用吧！那些好用的lib常見的套路與想法系列

D4 - Module的邊界

一個Module的內部應該包含哪些功能？這時候就要回到module的責任來看了責任分析一般會包含兩個角度高階/低階內聚/耦合簡單來說越高階，越接近API的...

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