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Quartus的verlog，寫出AND閘串50顆，用vwf模擬出延遲時間

quartus verilog vwf and delay time

justin_2491 2023-12-11 13:40:52 ‧ 570 瀏覽

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想在Quartus裡面，使用verilog寫出，AND閘串聯50～100個，看能不能用vwf模擬出delay time，看出延遲時間的長短

有試著問過chat gpt，但還是不知道怎麼寫或是該怎麼操作，希望有大佬能指導

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