這次就是實作 Exception
但是在 support 的同時也從 RV32IM 擴展成 RV32IM_zicsr 了
因為需要有一些 register 來提供相對應的控制
總共新增 CSRRW, CSRRS, CSRRC 和對應的 immediate 版本
還有 I 指令集裡的 ECALL 、 EBREAK
以及為了能讓 interrupt handler 運作的 MRET
還有對應的 CSR:
git link with tag: https://github.com/hsufit/TINY5_OOO/tree/ithome2026_D27
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