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鐵人賽 Software Development DAY 21

verilog or very lag 系列第 21 篇

技術【Day21】I2C的介紹

I2C是什麼？ I2C，又稱 I²C(Inter-Interated Circuit)，在 I2C 的通訊協定中，收發資料只單純靠兩條線就能完成，分別為 SCL...

jay_0314 ‧ 2021-10-06 ‧團隊NTUST HIS_LAB 有點東西

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鐵人賽 Software Development DAY 16

verilog or very lag 系列第 16 篇

技術【Day16】TestBench 的撰寫技巧

透過 Verilog 完成一個具有特定功能的電路後，並不代表你的工作已經完成了，TestBench(tb) 在電路設計中也是一個非常重要的環節，往往驗證電路所...

jay_0314 ‧ 2021-10-01 ‧團隊NTUST HIS_LAB 有點東西

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鐵人賽 Software Development DAY 13

數位 IC 設計起手式系列第 13 篇

技術 Day 13: 循序電路之序章

邏輯電路可以分成兩種，一種是我們之前在接觸的組合電路 (Combinational Circuit) ，另一種是比較難理解的循序電路 (Sequential C...

chmh0624 ‧ 2023-09-23

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鐵人賽 Software Development DAY 1

verilog or very lag 系列第 1 篇

達標好文技術【Day01】概述

Verilog 是什麼？ Verilog 是一種硬體描述語言（Hardware Description Language, HDL），用於數位電路的系統設計，是...

jay_0314 ‧ 2021-09-16 ‧團隊NTUST HIS_LAB 有點東西

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鐵人賽 Software Development DAY 10

verilog or very lag 系列第 10 篇

技術【Day10】模組化及引用模組

模組在一個 .V 檔案裡面，可以有很多個 module，但是 Top Module 只會有一個，所以檔名必須以 Top Module.v 來命名來辨別 Top...

jay_0314 ‧ 2021-09-25 ‧團隊NTUST HIS_LAB 有點東西

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鐵人賽 Software Development DAY 26

verilog or very lag 系列第 26 篇

技術【Day26】快速乘法器的實作（Booth演算法）

為什麼要自己寫乘法器？這篇會來教大家寫一個乘法器，那麼你可能會想：為什麼會需要乘法器呢？像我在 quartus 或 Vivado 裡打乘號也可以有乘法器用啊...

jay_0314 ‧ 2021-10-11 ‧團隊NTUST HIS_LAB 有點東西

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鐵人賽 Software Development DAY 10

數位 IC 設計起手式系列第 10 篇

技術 Day 10: BCD 加法器

簡單的模組觀念就先暫時說到這邊，我們先用之前所學的觀念來實作 BCD 加法器！ BCD 是什麼？數字的編碼方式其實有很多種，舉例來說，十進位是生活中常用的數字...

chmh0624 ‧ 2023-09-20

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鐵人賽 Software Development DAY 29

verilog or very lag 系列第 29 篇

技術【Day29】Cordic 演算法的實現

假設今天再做某種數位信號處理時，不小心用到了 arctan(y/x) 函數，那麼當然可以用泰勒展開得到多項式，化成一連串的乘法與加法運算，但是在這裡其實有另一個...

jay_0314 ‧ 2021-10-14 ‧團隊NTUST HIS_LAB 有點東西

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鐵人賽 Software Development DAY 15

verilog or very lag 系列第 15 篇

技術【Day15】狀態機的撰寫

什麼是狀態機呢？狀態機，其實是有限狀態機（finite-state machine(FSM)）的簡稱，字面上來看可以知道它是有有限個狀態，並且可以按照著特定的...

jay_0314 ‧ 2021-09-30 ‧團隊NTUST HIS_LAB 有點東西

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鐵人賽 Software Development DAY 24

verilog or very lag 系列第 24 篇

技術【Day24】I2C Master 的實現及驗證（最終章）

今天，我們要來完成整個 I2C 的最後一個部份了！先來看看這個 I2C Master write 模塊該有哪些輸入輸出腳吧：輸入： clk_sys rst_...

jay_0314 ‧ 2021-10-09 ‧團隊NTUST HIS_LAB 有點東西

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活動硬體加速迎戰深度學習、下世代5G通訊：FPGA實戰心法

ADAS、自動化工業，不僅需要強大的網路介面，而且需要安全基礎設施，FPGA可滿足通訊應用中乙太網互聯的性能要求，並能在硬體架構解決安全問題；以深度學習來說，因...

艾鍗學院 ‧ 2018-03-16

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鐵人賽學生 DAY 4

與 Verilog 在一起的三十天系列第 4 篇

技術與 Verilog 在一起的三十天 - Day 4 - 結構到底是圓的、扁的、還是高的？

Design & Testbench 比起畫硬體結構來看，Verilog 算是個程式語言，我個人覺得裏頭的概念有平行程式（因為電一來全部的模組都會開始動...

hydai ‧ 2014-10-04

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鐵人賽 Software Development DAY 30

verilog or very lag 系列第 30 篇

技術【Day30】Pipelined 加法器

什麼是 Pipelined？先以RISC-V架構來舉例：我們先來看看這張圖：圖片出處：源自 Computer Organization and Desi...

jay_0314 ‧ 2021-10-15 ‧團隊NTUST HIS_LAB 有點東西

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活動【FPGA即服務商機崛起！】SoC FPGA 實戰課程，4/14(六)開課！[艾鍗學院]

ADAS、工業自動化，不僅需要強大的網路介面，而且需要安全基礎設施FPGA可滿足通訊應用中乙太網互聯的性能要求，並能在硬體架構解決安全問題以深度學習來說，因應...

艾鍗學院 ‧ 2018-03-07

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鐵人賽 Software Development DAY 19

verilog or very lag 系列第 19 篇

技術【Day19】SPI 狀態機的實現

SPI是什麼？ SPI(Serial Peripheral Interface)，是一種同步的傳輸協定，主要應用於單晶片系統中。類似 I2C(之後會提到)，它的...

jay_0314 ‧ 2021-10-04 ‧團隊NTUST HIS_LAB 有點東西

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鐵人賽 Software Development DAY 12

verilog or very lag 系列第 12 篇

技術【Day12】Latch的生成條件以及如何避免(上)

什麼是 Latch ? 前幾篇在 if-else 以及 case 語句時有提到 latch，那什麼是 latch 呢？ latch 又俗稱"鎖存器&q...

jay_0314 ‧ 2021-09-27 ‧團隊NTUST HIS_LAB 有點東西

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鐵人賽 Software Development DAY 2

verilog or very lag 系列第 2 篇

技術【Day02】Verilog 基本簡介

Verilog 電路基本架構舉個簡單電路的例子： module adder( a, b, c ); input a; //輸入埠敘述 i...

jay_0314 ‧ 2021-09-17 ‧團隊NTUST HIS_LAB 有點東西

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鐵人賽 Software Development DAY 17

verilog or very lag 系列第 17 篇

技術【Day17】Uart_TX 狀態機的實現

Uart 是什麼？ UART(Universal Asynchronous Receiver/Transmitter)，是一種非同步的傳輸協定，非同步傳輸的意思...

jay_0314 ‧ 2021-10-02 ‧團隊NTUST HIS_LAB 有點東西

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鐵人賽 Software Development DAY 25

verilog or very lag 系列第 25 篇

技術【Day25】One-Wire protocol

One-Wire One-Wire是一種只需要一條線即可傳輸資料的傳輸協定，而通常這種傳輸協定會用於與小型裝置溝通，例如數位溫度、濕度感測器。那我們在這邊會以...

jay_0314 ‧ 2021-10-10 ‧團隊NTUST HIS_LAB 有點東西

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鐵人賽 Software Development DAY 27

verilog or very lag 系列第 27 篇

技術【Day27】線性收斂除法器實作

在加減乘除四個基本運算中，其中除法最為困難及複雜，因此除法也是最耗時的運算。對於一個被除數為 N，除數為 D，商為 Q，餘數 R 的除法運算中，我們可以得...

jay_0314 ‧ 2021-10-12 ‧團隊NTUST HIS_LAB 有點東西

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鐵人賽 Software Development DAY 16

數位 IC 設計起手式系列第 16 篇

技術 Day 16: 計數器概論

學會正反器之後，我們該應用一下了吧！之前提到正反器是一種有記憶的電路，透過這種電路，我們可以有不同的初始狀態。而我們要介紹的計數器就是其中一種應用。以 0 ~...

chmh0624 ‧ 2023-09-26

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技術 DE2_115(DAY1)以niosii去控制板子上的led燈

從學校拿到一塊DE2_115，之前修DCLAB的時候只有接觸Verilog的部分，現在想要學習板子上niosii的使用，所以來go_through 板子上教學檔...

power_hec ‧ 2022-02-01

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鐵人賽 Software Development DAY 4

數位 IC 設計起手式系列第 4 篇

技術 Day 04: Verilog 環境架設

不同的軟體支援不同的作業系統，因為我所使用的軟體都是免付費的，所以限制會稍多一點。但是找到可以被我們使用的環境才是我們的目的！ Windows 寫完了 Veri...

chmh0624 ‧ 2023-09-14

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技術 [分享] verilog设计经验总结

先记下来：1、不使用初始化语句；2、不使用延时语句；3、不使用循环次数不确定的语句，如：forever，while等；4、尽量采用同步方式设计电路；5、尽量采用...

小喳喳 ‧ 2021-01-12

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鐵人賽 Software Development DAY 27

數位 IC 設計起手式系列第 27 篇

技術 Day 27: Synthesizable Verilog

我們認識了數位電路設計的組合電路、循序電路，也學習了 Verilog 的語法和實際練習撰寫 Verilog 的程式碼。學習他們的最終目標到底是什麼？就是設計出...

chmh0624 ‧ 2023-10-07

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鐵人賽 Software Development DAY 17

數位 IC 設計起手式系列第 17 篇

技術 Day 17: 計數器實作

了解了計數器的規則，這一篇我們要來實作 Johnson Counter 和 Ring Counter ，其實兩者的實作差異不大，希望大家在學會 Johnson...

chmh0624 ‧ 2023-09-27

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鐵人賽 Software Development DAY 18

verilog or very lag 系列第 18 篇

技術【Day18】Uart_TX 的實現

既上一篇我們設計了 Uart_TX 的狀態機，我們今天要來引用狀態機模塊來實現這個 Uart_TX 的模塊。先來看看這個模塊該有哪些輸入輸出腳：輸入： c...

jay_0314 ‧ 2021-10-03 ‧團隊NTUST HIS_LAB 有點東西

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鐵人賽 Software Development DAY 28

verilog or very lag 系列第 28 篇

技術【Day28】2次收斂除法器實作

接下來探討一種透過牛頓法來找到相除解的方法收斂除法 Step1 : 規格化 N 和 D，令 D 趨近於 1，例如 0.5 <= D < 1 or...

jay_0314 ‧ 2021-10-13 ‧團隊NTUST HIS_LAB 有點東西

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技術 DE2_115(DAY3)以niosii去控制板子上的sdram

DE2_115(DAY3)以niosii去控制板子上的sdram 承接DAY2做的事情(https://ithelp.ithome.com.tw/article...

power_hec ‧ 2022-02-06

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鐵人賽 Software Development DAY 26

數位 IC 設計起手式系列第 26 篇

技術 Day 26: Compiler Directive

之前提到的議題都是在更加彈性設計電路，今天我們要介紹的是讓設計者方便撰寫 Verilog 程式碼。在 C 語言中，我們常常看見 #define, #includ...

chmh0624 ‧ 2023-10-06

技術 【Day21】I2C的介紹

技術 【Day16】TestBench 的撰寫技巧

技術 Day 13: 循序電路之序章

達標好文 技術 【Day01】概述

技術 【Day10】模組化及引用模組

技術 【Day26】快速乘法器的實作（Booth演算法）

技術 Day 10: BCD 加法器

技術 【Day29】Cordic 演算法的實現

技術 【Day15】狀態機的撰寫

技術 【Day24】I2C Master 的實現及驗證（最終章）

活動 硬體加速迎戰深度學習、下世代5G通訊：FPGA實戰心法

技術 與 Verilog 在一起的三十天 - Day 4 - 結構到底是圓的、扁的、還是高的？

技術 【Day30】Pipelined 加法器

活動 【FPGA即服務 商機崛起！】SoC FPGA 實戰課程，4/14(六)開課！[艾鍗學院]

技術 【Day19】SPI 狀態機的實現

技術 【Day12】Latch的生成條件以及如何避免(上)

技術 【Day02】Verilog 基本簡介

技術 【Day17】Uart_TX 狀態機的實現

技術 【Day25】One-Wire protocol

技術 【Day27】線性收斂除法器實作